PLC's - error al comprobar coherencias

   
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error al comprobar coherencias

Publicado por laureano (1 intervención) el 09/03/2009 11:06:55
En proyecto con step 7 tras comprobar coherencias
me da el siguiente aviso "el tiempo para el ciclo DP equidistante no puede ser
inferior a 4.131 ms." Devido al aviso no puedo compilar y guardar alguien sabe significado y forma de solucionarlo?
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